1樓：匿名使用者
更重要的來區別在於其製造源工藝，像現在大規模積體電路使用cmos工藝，在此工藝上標準邏輯單元都為與非、或非門。並沒有專門的與門、或門。所以邏輯表示式要轉化成與非或非的形式才能夠提高設計效率。
而在以往的積體電路設計中，也就是樓主所說的小規模和中規模（常見與90s年代），使用的是pmos或者nmos工藝。在這些工藝中可以構建and 和or ，但是代價是要付出很大的功耗。
純手碼。
msi和ssi對邏輯函式式的處理方法有什麼不同？
2樓：甜瓜
ssi（**allscaleintegratedcircuites)小規模積體電路可以直接實現組合邏輯函式，並且用的組合邏輯電路元件少，連線簡單，省時省力，可靠性也高，是進行組合邏輯電路設計的一種重要方法。
msi(mediumscaleintegratedcircuites）電路也可以用的，但是要用的組合電路元件多，所以連線複雜，操作起來麻煩，其穩定性和可靠性不高，主要用來設計較小規模積體電路，應用沒有msi廣泛。
3樓：缼之可慶
函式邏輯式的處理方法
使用中,小規模整合門電路設計組合邏輯電路的一般方法是什麼?
4樓：丿奇
先確定輸入輸出，
再列他們之間關係的真值表，
然後根據真值表寫出邏輯函式表示式，
最後根據函式表示式畫出電路圖。
怎樣設計組合邏輯電路 15
5樓：柒月黑瞳
組合邏輯電路的設計與分析過程相反，其步驟大致如下：
（1）根據對電路邏輯功能的要求，列出真值表；
（2）由真值表寫出邏輯表示式；
（3）簡化和變換邏輯表示式，從而畫出邏輯圖。
組合邏輯電路的設計，通常以電路簡單，所用器件最少為目標。在前面所介紹的用代數法和卡諾圖法來化簡邏輯函式，就是為了獲得最簡的形式，以便能用最少的閘電路來組成邏輯電路。但是，由於在設計中普遍採用中、小規模積體電路（一片包括數個門至數十個門）產品，因此應根據具體情況，盡可能減少所用的器件數目和種類，這樣可以使組裝好的電路結構緊湊，達到工作可靠而且經濟的目的。
6樓：
這麼簡單的設計：
步驟：1.寫出真值表：（輸入a、b、c 輸出：f）2.根據真值表畫卡諾圖得出最簡表示式：
f=ab+bc+ac
3.把最簡表示式化簡成與非-與非式：
f= [（ab的非）與（bc的非）與（ac的非）] 的非4.根據以上與非-與非表示式畫圖。
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