1樓：網友
你將200路訊號作為單個訊號並行輸入，同時判斷200個訊號的變化，如果有乙個或多個就將他們用&連線成200位的序列訊號輸出。
求乙個fpga高速訊號採集設計方案
2樓：網友
其實基於fpga的高速訊號採集幾乎都是相同的設計原理。就是先adc取樣訊號，將模擬訊號轉換為數碼訊號，然後交由fpga。而此時的fpga需要寫3個ip模組：
ip核1、控制adc自動高速轉換的狀態機。其作用是實現高速100m的訊號取樣，就是乙個迴圈的時序控制，讓adc轉換一次完成之後由fpga讀出資料並將資料交由第二個ip核（fifo快取控制ip），然後立刻讀取第二次資料。但是需要注意adc晶元的選擇，器轉換速率必須要高於100mhz。
ip核2、fifo快取控制核：如果說想要實現採集資料的高可靠性和穩定性的話，fifo一般來說是必須存在的。fifo的ip核判斷adc一次取樣是否結束，如果結束，將資料存在fifo的快取區1。
然後在第二次取樣的時候讓ip核3將快取區1的資料讀走然後清空快取區1的資料，並同時將第二次讀到的取樣資料存進快取區2，然後又將第二次讀的資料讓ip核3從快取區2讀走，同時adc取樣並存資料到快取區1。（也就是說，fifo分為兩個快取區，總是乙個用來儲存adc轉換後的資料，另乙個用來讓後面的功能模組讀出上一次取樣到的資料。兩個是同時的。
快取區1和快取區2交替工作。）
ip核3：處理數碼訊號的功能模組。你說到了你的任務是adc轉換這一塊，所以ip核3你只需要交替讀出fifo兩個快取區的資料就ok。
1.低速是不是不需要fifo模組？
答：fifo其實無論是高速還是低速都可以省掉，只是為了系統的穩定性和取樣速率的穩定性、採集資料的高可靠性所以次啊加的fifo快取器。
2.高速訊號pcb佈線應注意什麼？
答：1.電源濾波一定要做好，否則有紋波。
2.正電源(vcc)的所有線路最好用兩根地線（gnd）將它夾在中間，（如果整個板子都鋪銅，這個可以不考慮）。
3.雙面板需要將正反兩面的走線方向垂直，可以減小emc。
4.模擬電源和數字電源分開，地也一樣。整個板子上的數字電源和模擬電源用兩個個0歐電阻連線。（1個電源正，乙個地）
5.最好鋪銅。
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