1樓：金木南影娛
quartus ii 全編譯出現嚴重警告按以下方式解決：
首先看命令 derive_clock_uncertainty 的幫助，再根據自己的問題在*.sdc檔案中加入。
set_clock_uncertainty -setup -rise_from clock -rise_to clock
set_clock_uncertainty -hold -rise_from clock -rise_to clock
儲存，重新編譯。嚴重警告就消失了。
quartusii高手請進。做一數字鐘，編譯通過，**結果老是全0，出現下面警告。 求解！！
2樓：網友
意思是節點或者匯流排名lhr[3]重複。我空間裡有quartus的錯誤大全，你看看吧。
3樓：匿名使用者
大哥，怎麼解決的，求解啊？
quartus ii 編譯時出現錯誤，求各位大神解決！！ 20
4樓：昝浚
很明顯你的license安裝不正確，建議重新下乙個破解器，破解quartus，網上的破解器是支援 ep2c35f672c6的，除非你的軟體版本太低。
5樓：網友
看你建立檔案的名字和實體名字是否一致。
6樓：小黑黑小白
看路徑是否含有中文、空格等吧~~~新建乙個，編譯下！
7樓：網友
請問你的這個問題是怎麼解決的，我也出現了這樣的問題，謝謝。
quartus ii編譯時出現錯誤 130
8樓：包亙衛桃
第一條是沒有找到所需要的初始化檔案或者已經編譯生成的hex檔案，如果有其他編譯軟體的話，請在編譯時，生成hex檔案前打鉤。
第二條也許是always的敏感變數出現問題，沒有給出程式一時無法解決。
一共兩條錯誤，後面的是warning，可以不予理睬。
9樓：匿名使用者
時鐘clk0輸入給pll1了，就不要再輸出給其他模組了。
其他模組的時鐘用pll1的c0代替。
10樓：匿名使用者
urg 緊急指標。
ack 確認序號有效。
psh 接收方應該盡快將此報文段交給應用層rst 重建連線。
syn 同步序號發起乙個鏈結。
fin 傳送端完成傳送任務。
11樓：我飛故我在
乙個是時序約束，另乙個就是邏輯鎖定。時序約束是按照你的時序要求去布局佈線。而邏輯鎖定則是指設計者將某個模組或者某個網路指定在器件的某個位置。
儘管有時序約束，但綜合器也不能保證每次都能達到要求；而只有當邏輯鎖定後，它能保證被鎖定的模組在下一次綜合不被改變。
事出有因，之前加進來的乙個spi模組，一開始是正常的，後來陸續在設計中加了一些模組，綜合後，居然發現spi模組工作不正常，奇怪的是，在我備份的幾個版本中，有幾個正常，有幾個又不正常，而在這個過程中spi模組從未被修改過。我想一定是綜合器在搗鬼，後來我在spi正常的版本上檢視chip
planner中spi的布局資訊，然後將其邏輯鎖定，再新增新的模組進來，結果發現，spi果然沒有受到影響。
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